OA5102

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 從串配置模式

在串行模式下，需要微處理器或微控制器等外部主機通過同步串行接口將配置數據串行寫入FPGA芯片，其模式選擇信號M[2:0]=3’b111。典型的Spartan 3E系列FPGA單片配置電路如圖5.5.11所示。DIN輸入管腳的串行配置數據需要在外部時鐘CCLK 信號前有足夠的建立時間。其中單片FPGA 芯片構成了完整的JTAG鏈，僅用來測試芯片狀態，以及支持JTAG 在線調試模式，與從串配置模式沒有關系。外部主機通過下拉PROG_B啟動配置并檢測INIT_B 電平，當INIT_B 為高時，表明FPGA 做好準備，開始接收數據。此時，主機開始提供數據和時鐘信號直到FPGA 配置完畢且DONE 管腳為高，或者INIT_B 變低表明發生配置錯誤才停止。整個過程需要比配置文件大小更多的時鐘周期，這是由于部分時鐘用于時序建立，特別當FPGA 被配置為等待DCM鎖存其時鐘輸入。

圖5-32 FPGA從串配置電路示意圖

此外，從串配置模式也可配置多片FPGA芯片，典型的兩片Spartan 3E系列FPGA的從串配置電路如圖5-33所示。所有芯片的CCLK信號都有主控設備提供，靠近主控設備的FPGA要充當橋梁的作用，將配置數據轉發到第二個FPGA芯片。可以看到采用從串配置的好處主要在于節省電路板面積，并使得系統具備更大的靈活性。

：歐工
               
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