B&R X20BB80
B&R X20BB80
圖12 具有同步寄存器輸出的多時鐘系統 (如果CLK_A和CLK_B是相互獨立的,則REG—A的輸出必須在它饋送到1REG_B之前,用REG_C同步化)
在許多應用中只將異步信號同步化還是不夠的,當系統中有兩個或兩個以上非同源時鐘的時候,數據的建立和保持時間很難得到保證,我們將面臨復雜的時間問題。的方法是將所有非同源時鐘同步化。使用PLD內部的鎖項環(PLL或DLL)是一個效果很好的方法,但不是所有PLD都帶有PLL、DLL,而且帶有PLL功能的芯片大多價格昂貴,所以除非有特殊要求,一般場合可以不使用帶PLL的PLD。 這時我們需要使用帶使能端的D觸發器,并引入一個高頻時鐘。
圖13 不同源時鐘
如圖13所示,系統有兩個不同源時鐘,一個為3MHz,一個為5MHz,不同的觸發器使用不同的時鐘。為了系統穩定,我們引入一個20MHz時鐘,將3M和5M時鐘同步化,如圖15所示。 20M的高頻時鐘將作為系統時鐘,輸入到所有觸發器的的時鐘端。3M_EN 和5M_EN將控制所有觸發器的使能端。即原來接3M時鐘的觸發器,接20M時鐘,同時3M_EN 將控制該觸發器使能 ,原接5M時鐘的觸發器,也接20M時鐘,同時5M_EN 將控制該觸發器使能。 這樣我們就可以將任何非同源時鐘同步化。
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